DRC
Design Rule Check也称 设计规则检查、物理规则检查、版图规则检查
用目标工艺的规则集检查版图几何、层间关系和局部制造约束是否落在允许窗口内。
速览
约 1 分钟DRC把版图多边形和派生层送入工艺规则集,定位最小线宽、间距、包围、延伸、密度和天线等违例;它回答“几何是否符合规则”,不回答电路是否连对。
系统理解
约 2 分钟设计规则来自工艺整合、光刻、刻蚀、沉积、平坦化和可靠性等制造边界,并由与工艺版本绑定的规则文件实现。检查器会从原始层生成相交、膨胀、收缩等派生几何,再验证同层与跨层关系。实现阶段可做局部增量检查,流片候选仍需对冻结数据库执行全芯片签核;任何豁免都必须保留规则编号、位置、适用条件和批准依据。
位于详细布线和版图整理之后,与LVS、寄生和其他签核共同构成流片候选的物理出口。
公式提示
典型几何约束可写成W≥Wmin、S≥Smin、E≥Emin;具体最小值、测量方向、邻近条件和例外均由目标工艺规则定义。
关键参数
| 参数 | 单位 | 含义 |
|---|---|---|
| 最小线宽 | m | 指定层图形允许的最小局部宽度 |
| 最小间距 | m | 指定图形组合之间允许的最小边到边距离 |
| 包围/延伸量 | m | 一层相对另一层必须覆盖或伸出的最小距离 |
| 局部图形密度 | — | 规定窗口内某层图形面积占窗口面积的比例 |
常见误区
- 认为DRC只检查两条线之间的最小距离
- 认为DRC通过就代表版图与原理图一致
- 认为同一规则文件可以脱离工艺版本和层映射复用
- 认为删除或豁免错误标记不会引入新的制造风险
工程深入
12 条结论规则来源与检查对象
几何、密度与制造风险
闭环、豁免与签核边界
出处
3 本教材 · 3 处引用- 1
超大规模集成电路物理设计:从图分割到时序收敛
- 第 1 章 §1.2 设计流程第6–7步,第 7–8 页 支持:DRC检查版图几何是否满足目标工艺规则;设计规则是制造能力在设计端的几何接口;最小宽度、间距和包围量是带条件的不等式;派生层把多层图形关系转化为可检查对象;密度规则检查窗口内的面积比例而非单条边;天线规则针对加工充电而非射频天线;一处修复可能在邻近位置产生新违例;错误标记指出症状而不总是指出根因;局部检查用于迭代,全芯片检查用于签核;豁免是有条件的工程判断而不是清零手段;DRC clean不等于电路或产品正确;DRC把布局布线结果连接到流片签核
- 2
CMOS超大规模集成电路设计(第4版)
- 第 1 章 §§1.11–1.12,第 45–48, 页 支持:DRC检查版图几何是否满足目标工艺规则;设计规则是制造能力在设计端的几何接口;最小宽度、间距和包围量是带条件的不等式;派生层把多层图形关系转化为可检查对象;密度规则检查窗口内的面积比例而非单条边;天线规则针对加工充电而非射频天线;一处修复可能在邻近位置产生新违例;错误标记指出症状而不总是指出根因;局部检查用于迭代,全芯片检查用于签核;豁免是有条件的工程判断而不是清零手段;DRC clean不等于电路或产品正确;DRC把布局布线结果连接到流片签核
- 3
芯片设计:CMOS模拟集成电路设计与仿真实例(基于Cadence IC 617)
- 第 1 章 §§1.3–1.4 支持:DRC检查版图几何是否满足目标工艺规则;设计规则是制造能力在设计端的几何接口;最小宽度、间距和包围量是带条件的不等式;派生层把多层图形关系转化为可检查对象;密度规则检查窗口内的面积比例而非单条边;天线规则针对加工充电而非射频天线;一处修复可能在邻近位置产生新违例;错误标记指出症状而不总是指出根因;局部检查用于迭代,全芯片检查用于签核;豁免是有条件的工程判断而不是清零手段;DRC clean不等于电路或产品正确;DRC把布局布线结果连接到流片签核