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半导体开放世界

高速互连串扰

High-Speed Interconnect Crosstalk(NEXT / FEXT)也称 近端串扰、远端串扰、邻道耦合、aggressor victim、near-end crosstalk、far-end crosstalk

高速串扰是侵扰通道经电容、电感和共享回流路径把时变能量耦合到受害通道,并按近端、远端、频率、方向和同时切换条件改变眼图与BER。

报告问题

速览

约 1 分钟

两条高速线靠得太近时,一条线的电场、磁场和回流电流会影响另一条。受害线靠近发送端看到NEXT,远端看到FEXT;其大小不只由间距决定,还与并行长度、参考平面、边沿、端接、方向和多条侵扰线是否同时切换有关。

系统理解

约 3 分钟

相邻互连通过互电容Cm和互电感Lm耦合。电容耦合注入与电压变化率相关的电流,电感耦合由共享磁通和电流变化率形成感应电压;二者在近端和远端的极性与传播叠加不同,因此NEXT与FEXT不能只按同一标量解释。回流路径不连续还会扩大共享阻抗耦合。

串扰是方向性多端口问题。侵扰端口、受害端口和终端条件必须明确;频域以相应S参数或混合模串扰项描述幅相,时域用TDR/TDT或激励码型观察脉冲到达。耦合长度增加通常提高累积耦合,但损耗、相速度差、端部反射和多段耦合会产生相消或谐振。

真实系统常有多条侵扰lane。各lane码型、相位、幅度、数据率和相关性决定瞬时叠加;简单把单侵扰dB数线性相加会忽略功率/相位和相关性。PAM4较小电平间距、CTLE高频峰化和接收阈值使同等串扰更容易压缩垂直眼。

减缓方法包括增距、缩短并行区、调整层与正交走线、连续参考平面、地过孔围栏、差分对称、连接器引脚分配和屏蔽。签核需在校准参考面获得完整多端口S参数,包含最坏允许侵扰组合并检查眼图、COM或BER;只在静态未激活邻道下通过不是多lane系统结论。

承接传输线、多端口S参数、TDR和封装互连,向后连接模式转换、COM、PAM4、均衡、受压接收机和多lane可靠性。

公式提示

弱耦合集总近似中电容串扰电流ic≈Cm·dv/dt,电感感应电压vm≈Lm·di/dt;长分布通道必须使用多端口传播与终端模型,不能直接用该近似外推。

关键参数

关键参数
参数单位含义
NEXT、FEXT与端口方向dB / complex定义耦合从何处注入并在哪里观察
互电容、互电感与共享回流F/m / H/m / Ω决定耦合机制
间距、并行长度、层与参考平面m决定物理耦合区域
侵扰数量、码型、相位与相关性count / —决定多lane瞬时叠加
ICN、眼图、COM与BERV rms / dB / ratio把串扰网络连接到接收判决

常见误区

  • 认为差分信号天然免疫所有串扰
  • 只用线间距预测串扰而忽略回流和耦合长度
  • 把NEXT与FEXT当作同一端口方向的指标
  • 把多个侵扰dB数直接算术相加
  • 邻道关闭时眼图通过就宣称整机通道合格

工程深入

16 条结论 · 1 道例题

耦合机理

定义

串扰是侵扰通道到受害通道的非期望耦合

相邻互连经电场、磁场和共享回流把侵扰信号的一部分传到受害通道。12

成立条件 侵扰与受害端口明确;通道在小信号下近似线性

公式

互电容把电压变化率转为受害电流

弱耦合集总近似下,边沿越快和互电容越大,注入受害线的瞬时电流越大。12

ic≈Cmdvdti_c\approx C_m\frac{dv}{dt}
ic≈Cm·dv/dt
Cm
互电容,单位 F

成立条件 耦合区电长度较短;仅作局部机理解释

公式

互电感把电流变化率转为感应电压

共享磁通使侵扰电流边沿在受害回路产生感应电压,回路面积与回流路径决定Lm。12

vm≈Lmdidtv_m\approx L_m\frac{di}{dt}
vm≈Lm·di/dt
Lm
互电感,单位 H

成立条件 弱耦合集总近似;回路边界已定义

边界

长耦合区必须按分布传播求解

当耦合长度相对边沿传播距离不可忽略,端部反射、相速度差与沿线叠加使集总Cm/Lm公式不足。12

成立条件 快边沿或长并行区;使用多导体传输线或多端口S参数

NEXT与FEXT

定义

NEXT在侵扰发送端同侧观察

近端串扰的受害接收端与侵扰激励端位于耦合区同一侧,端口方向必须在报告中明确。12

成立条件 端口映射与方向固定;终端匹配状态已知

定义

FEXT在耦合区远端观察

远端串扰沿传播方向到达耦合区另一端,其幅相受偶模/奇模速度差和损耗显著影响。12

成立条件 远端端口和传播方向明确;测量带宽覆盖目标频段

边界

串扰dB离不开端口与参考阻抗

同一物理结构在不同端口编号、差分组合、参考阻抗和终端下会得到不同耦合项。12

成立条件 Touchstone端口定义可追溯;差分端口配对一致

机制

时域到达时间可定位耦合区

TDT观察受害端的耦合脉冲及其延迟,可区分近端、远端和多段耦合,但不能取代完整频域幅相。12

成立条件 仪器通道已deskew;夹具响应已校准或去嵌

多侵扰与系统后果

边界

多个侵扰不能把dB值直接相加

相关信号需按复幅相叠加,独立随机数据通常按功率统计组合;最坏确定性相位又是另一边界。12

成立条件 侵扰相关性已知;区分峰值和均方根

机制

码型和相位决定瞬时最坏叠加

相同串扰网络在不同侵扰码型、边沿同时性和相位偏移下产生不同受害波形与错误突发。12

成立条件 覆盖规定侵扰码型;侵扰幅度与相位可追溯

关联

CTLE会放大频带内串扰

线性均衡无法区分高频信号与邻道耦合,增强通道高频时也可能提高串扰和噪声。12

成立条件 串扰频谱落在CTLE提升带;比较均衡前后BER

边界

差分传输只抑制部分共同耦合

对两根线完全相同的共模干扰可被差分相减,但非对称耦合和模式转换仍形成差分误差。12

成立条件 接收CMRR有限;差分对存在真实不对称

布局与验证

机制

增距和缩短并行区降低直接耦合

更大间距和更短平行走线通常减小互电容互电感,但过孔、连接器和回流缝隙仍可能主导。12

成立条件 完整三维路径评估;不只检查直线PCB段

机制

连续回流减少共享阻抗耦合

参考平面连续、过孔换层回流就近和地围栏可限制场扩散;开槽与大回路会让相隔较远通道仍耦合。12

成立条件 检查信号与返回电流完整回路;跨层过孔有返回路径

边界

单侵扰测量不能代表满lane系统

多lane同时活动时的统计与峰值组合可能显著高于单lane结果,合规需使用规定侵扰集合。12

成立条件 全部规定侵扰端口纳入;覆盖活动率和相关性

公式

两独立等功率侵扰使rms噪声增至√2倍

若两侵扰各产生1 mV rms且独立不相关,均方根合成为√(1²+1²)=1.414 mV,而不是2 mV。12

Vrms,total=V12+V22=2=1.414 mVV_{\mathrm{rms},\mathrm{total}}=\sqrt{V_1^2+V_2^2}=\sqrt2=1.414\,\mathrm{mV}
Vrms,total=√(V1²+V2²)=√2=1.414 mV
V1,V2
各独立侵扰的均方根电压,单位 V rms

成立条件 两个分量不相关;均为同观察带宽的rms

例题:动手算一次教学假设,可复算

两个独立侵扰各贡献1 mV rms,合成rms是多少?

已知

  1. V1=1 mV rms
  2. V2=1 mV rms
  3. 两者独立

步骤

  1. V²total=1²+1²=2 mV²,不相关功率相加。
  2. Vtotal=√2=1.414 mV rms,对总均方值开方。
结果 约1.414 mV rms。

独立噪声按平方和合成。

不能外推到 完全相关同相侵扰可线性相加;真实串扰需使用标准规定的相关性与频谱模型。

出处

2 份资料 · 2 处引用
  1. 1

    Signal Integrity Simulation Using Advanced Design System

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  2. 2

    Understanding the Transition to Gen4 Enterprise and Datacenter I/O Standards

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